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利用 CPLD 降低處理器功耗
利用 CPLD 降低處理器功耗
 更新時(shí)間:2008-8-3 15:44:39  點(diǎn)擊數(shù):30
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    這些只是設(shè)計(jì)方法中可用來降低任意終端應(yīng)用的功耗的幾個(gè)例子。 

    其中最重要的節(jié)電技法之一是管理系統(tǒng)中器件操作模式的能力。如今,許多制造商提供的器件都具有節(jié)電模式,即暫時(shí)將器件從其正常操作模式掛起。這些器件如果在特定時(shí)長(zhǎng)內(nèi)不活動(dòng),可以選擇關(guān)閉電源或轉(zhuǎn)至非工作狀態(tài)。如今的許多微處理器和微控制器都具備這種功能。通過利用和管理 PCB 上功耗大戶(如處理器)的操作模式,可以顯著降低系統(tǒng)的總體功耗。 

    降低功耗不僅涉及正確管理器件的操作模式,還涉及到設(shè)計(jì)能利用器件可用操作模式的系統(tǒng)。卸載微處理器的操作任務(wù)可使微處理器在較長(zhǎng)時(shí)間內(nèi)保持低功耗狀態(tài)。降低系統(tǒng)功耗的一種方法是讓低功耗可編程邏輯器件(如 CPLD)管理這些卸載的操作。本文講述這種方法以及可使處理器保持較長(zhǎng)低功耗狀態(tài)的操作類型,以期降低系統(tǒng)功耗。 

 

 

微處理器操作模式 

    在某些便攜式應(yīng)用中,CPU 功耗可達(dá)總體系統(tǒng)功耗的 30%。圖 1 所示為無線上網(wǎng)機(jī)應(yīng)用中系統(tǒng)組件的典型功耗。 

    在正常工作狀態(tài)下,微處理器的功耗范圍可達(dá) 720μW 上一頁(yè)  [1] [2] [3] [4] [5] [6] [7] [8] [9] [10] [11] [12] [13] [14] [15]  下一頁(yè)

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